Verilog

          verilog中clock不使用negedge的三個原因
               摘要: clk為什么要用posedge,而不用negedge呢?  閱讀全文

          posted @ 2007-04-23 17:40 肥蟲 閱讀(3248) | 評論 (0)  編輯

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